Universidad Autónoma de Nuevo León
Facultad de Ingeniería Mecánica y Eléctrica
Sistemas Digitales PROYECTO FORMATIVO 3
Natalia Daenna González Viera 1843929 M1 N.L. 28 Ing. Juan Ángel Garza Garza
Fecha de elaboración: 07/03/19 - 09/04/19 Tiempo estimado de elaboración: 11 horas PROYECTO FORMATIVO 3 - NATALIA DAENNA GONZÁLEZ VIERA
SISTEMAS DIGITALES M1 – NL. 28
UANL * FIME
Redacción del problema: Se trata de diseñar y efectuar una simulación, construyendo un prototipo en una tabilla de conexiones, tratándose de un sistema digital combinacional que funcione como decodificador de BCD a 7 segmentos por medio de un Dispositivo Lógico Programable (PLD), siendo el GAL16V8D el elegido en esta ocasión, el cual se programará usando el comando Truth_table en el lenguaje ABEL_HDL para ahorrarnos en gran medida el proceso o combinaciones innecesarias, también con ayuda del “Don’t Care” (.x.). Para esto se necesitó un display de 7 segmentos el cual podría ser ánodo común o cátodo común, que en mi caso conseguí un cátodo común, para lo cual los 1 indicarán que se prenda cierto LED, tratándose de 8 LED’s (a, b, c, d, e, f, g, dp) incluyendo al punto decimal, de lo cual a pesar de contar con 10 terminales 2 de ellas son comunes, siendo únicamente de ayuda para colocar la resistencia, ya que a pesar de proporcionarles energía no darían ninguna señal lumínica, como sucede con las otras terminales, las cuales al ser seleccionadas en grupos pequeños o grandes incluyéndolas a casi todas, logran formar números y algunas letras en el display.
Diagrama de bloques:
PROYECTO FORMATIVO 3 - NATALIA DAENNA GONZÁLEZ VIERA
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Tabla de verdad m
LT
0
0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 1
1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16, 31
A
BCD B
C
D
a
b
c
0 0 0 0 0 0 0 0 1 1 1 1 1 1 1 1 X
0 0 0 0 1 1 1 1 0 0 0 0 1 1 1 1 X
0 0 1 1 0 0 1 1 0 0 1 1 0 0 1 1 X
0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 X
1 0 1 1 0 1 1 1 1 1 0 1 1 0 0 1 1
1 1 1 1 1 0 0 1 1 1 1 1 0 0 0 1 1
1 1 0 1 1 1 1 1 1 1 1 1 0 1 1 1 1
7 segmentos d e 1 0 1 1 0 1 1 0 1 0 1 0 1 0 0 0 1
1 0 1 0 0 0 1 0 1 0 1 1 1 1 1 1 1
f
g
dp
V(10)
1 0 0 0 1 1 1 0 1 1 0 1 1 0 0 1 1
0 0 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1
0 0 0 0 0 0 0 0 0 0 1 1 1 1 1 1 1
0 1 2 3 4 5 6 7 8 9 10 (d) 11 (A) 12 (E) 13 (n) 14 (n) 15 (A) 16 (LT)
Simulación Test_Vectors
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Código ABEL-HDL
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Simulación Proteus
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Ecuaciones mínimas
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Distribución de terminales
Foto del circuito en la tabilla de conexiones
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Materiales utilizados:
• • • • • •
5 led 5mm 13 resistores 330 ohm GAL16V8D 2 metros de cable para alambrar calibre 22 1 display LED 7 segmentos 10 switch push micro NO (interruptor de no retención normalmente abierto)
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Conclusiones En conclusión, puedo decir que este proyecto fue muy sencillo para mí, mas de lo que imaginaba, ya que obviamente con la practica previamente obtenida, gracias a las actividades y anteriores proyectos formativos fui encontrándome con errores insignificantes tanto en ISPLever como en Proteus, pero ahora al conocer ya muchos de ellos y haber pasado por éstos, e inclusive haber necesitado de dos días para resolverlos, fue mucho más fácil y rápido lidiar con ellos. También luego al conocer el otro comando “Don’t Care” (.x.) e inclusive saber que la declararlo con cierto valor igualado a “X” me di cuenta que era aún más sencillo a pesar de la necesidad de colocar una tabla de verdad, siendo muy simple de realizar, para lo cual simplemente necesité colocar “x” en cada espacio donde no importaba el valor que se aplicara a determinada entrada, y en los valores que ya se necesitara un valor más conciso pues era como desde un inicio aprendí, desde la creación de los prototipos más básicos que formé. Una de las cosas que mejor comprendí gracias a este proyecto fue el haberme encontrado con un error, aunque suene un poco absurdo, ya que éste me hizo comprender la verdadera diferencia entre truth_table y test_vectors e identificar cada uno de los diferentes tipos de archivos.
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Recomendaciones Una gran recomendación que puedo hacer es evitar la desesperación al encontrarse con un error ya sea de sintaxis u otros errores con orígenes un poco más difíciles de identificar correctamente, pero a pesar de eso hay que mejor enfocarse en encontrar el error, buscando previamente en las ideas precisas y exactas con las que consideramos y adaptamos nuestras codificaciones en ispLEVER o ya sea en la manera en que representamos el circuito en Proteus. Otra de las recomendaciones que puedo dar gracias a la experiencia previa con este trabajo por mi parte es que hay ante todo hay que comprender perfectamente el problema e identificar de igual manera cada una de las entradas y las salidas, y la dependencia de cada una de estas para lograr una buena expresión ya sea en la codificación que sea, mientras sea comprensible por nosotros, y captada tan bien que si nos encontramos con un error fácilmente sepamos de qué se trató y cómo podríamos solucionarlo, y ya si bien no encontramos manera de identificarlo recurrir al internet.
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Referencias bibliográficas Rubén Estrada Marmolejo. (2018). Display 7 Segmentos ánodo y cátodo común. 08/04/19, de HETPRO Sitio web: https://hetpro-store.com/TUTORIALES/display-7-segmentosanodo-catodo-comun/
Mario Castañón. (2017). DECODIFICACIÓN BCD A CÓDIGO DE 7 SEGMENTOS. 07/04/19, de Ladelec Sitio web: http://www.ladelec.com/teoria/electronica-digital/346decodificacion-bcd-a-codigo-de-7-segmentos
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